岗位职责
岗位职责:
1. 与架构团队合作制定微架构;
2. 开发模块 RTL,有 DDR、PCIE、NIC 总线、视频编解码等任一经验者优先考
虑;
3. 与验证团队合作制定验证计划,功能 debug,分析和提高验证覆盖率直到验
证收敛;
4. 与后端团队合作收敛时序;
5. 负责性能,功耗和面积(PPA)优化;
任职要求:
1. 掌握 verilog,system Verilog,精通逻辑设计知识;
2. 具有 3~10 年逻辑设计经验,熟悉从微架构、RTL coding、综合等流程;
3. 熟悉覆盖率驱动,有约束随机验证方法学并有相关经验;
4. 熟悉计算机体系结构、GPU 架构者优先;
5. 具备良好的沟通能力、独立工作能力和团队驱动能力,以及分析问题和解决问
题的能力,能协调各相关团队推动方案完成
岗位要求
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1. 与架构团队合作制定微架构;
2. 开发模块 RTL,有 DDR、PCIE、NIC 总线、视频编解码等任一经验者优先考
虑;
3. 与验证团队合作制定验证计划,功能 debug,分析和提高验证覆盖率直到验
证收敛;
4. 与后端团队合作收敛时序;
5. 负责性能,功耗和面积(PPA)优化;
任职要求:
1. 掌握 verilog,system Verilog,精通逻辑设计知识;
2. 具有 3~10 年逻辑设计经验,熟悉从微架构、RTL coding、综合等流程;
3. 熟悉覆盖率驱动,有约束随机验证方法学并有相关经验;
4. 熟悉计算机体系结构、GPU 架构者优先;
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工作地址
山东省烟台市福山区·业达科技园
HR信息
王晓娜
3日内活跃
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